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樓主: lfljiang
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高速PCB中常見存儲器之SDRAM引腳認識、布局布線設計

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發(fā)表于 2018-2-28 16:19:56 | 只看該作者
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發(fā)表于 2018-3-14 19:57:59 | 只看該作者
好好好或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或或
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發(fā)表于 2018-3-14 20:21:24 | 只看該作者

+ r  o9 O) \3 Z: Y( N4 v- E5 m謝謝分享�。。。。。。�！
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發(fā)表于 2018-3-15 08:42:17 | 只看該作者
謝謝分享學習了，好東西
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發(fā)表于 2018-3-18 12:11:44 | 只看該作者
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發(fā)表于 2018-3-21 09:45:06 | 只看該作者
學習學習了�。�
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發(fā)表于 2018-4-18 16:32:12 | 只看該作者
樓主   空間允許的情況下,應該在它們走線之間加一根地線進行隔離，這個走線之間只的是哪些信號？是數(shù)據(jù)線、地址線、時鐘線分組之間嗎？
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發(fā)表于 2018-4-21 14:12:11 | 只看該作者
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發(fā)表于 2018-4-21 22:01:10 | 只看該作者
好東西啊。謝謝。。。。。
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發(fā)表于 2018-4-30 10:17:42 | 只看該作者
a54v                 
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